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OrCAD LOGIC COMPILER  v2.01 N 12/09/94  (Source file .\PLD\#0151.PLD)

  1  || FILE:   #0151.PLD
  2  || PROJ:   20120600        
  3  || PART:   G20V8-#0151
  4  ||
  5  || DEV :   GAL20V8
  6  ||
  7  ||         DESC:   DECODER I/O WAIT
  8  ||
  9  |
 10  |GAL20V8A
 11  |
 12  || INPUT
 13  |  1:A0, 2:A1, 3:A2, 4:A3, 5:A4, 6:A5, 7:A6, 8:A7,  
 14  |  9:IO1, 10:-, 11:WA0, 13:WA1, 14:WV, 23:WT,
 15  || OUTPUT 
 16  |  15:ATA0, 16:ATA1, 17:DMA, 18:FDC, 19:VDC, 20:IOX, 21:PIA, 22:WAIT
 17  |
 18  | ACTIVE-LOW: ATA0, ATA1, DMA, FDC, VDC, IOX, PIA, WAIT
 19  |
 20  |  PROPERTY: "SIMPLE"
 21  |
 22  | SIGNATURE: "0151    "
 23  |
 24  || --------------------------------------------------------
 25  || ATA 0/1
 26  || ATA0A => FE20 - FE27 (ATA 0)
 27  |  ATA0A = (IO1' & A7' & A6' & A5  & A4' & A3')
 28  || ATA0B => FE2E - FF2F (ATA 0)
 29  |  ATA0B = (IO1' & A7' & A6' & A5  & A4' & A3 & A2 & A1)
 30  || ATA0C => FE2C (ATA 0)
 31  |  ATA0C = (IO1' & A7' & A6' & A5  & A4' & A3 & A2 & A1' & A0')
 32  || ATA1A => FE30 - FE37 (ATA 1)
 33  |  ATA1A = (IO1' & A7' & A6' & A5  & A4  & A3')
 34  || ATA1B => FE3E - FE3F (ATA 1)
 35  |  ATA1B = (IO1' & A7' & A6' & A5  & A4  & A3 & A2 & A1)
 36  || ATA1C => FE3C (ATA 1)
 37  |  ATA1C = (IO1' & A7' & A6' & A5  & A4  & A3 & A2 & A1' & A0')
 38  ||
 39  || SELEZIONE ATA 0 -> FE20 - FE27, FE2C, FE2E - FE2F
 40  |  ATA0 = (ATA0A # ATA0B # ATA0C)
 41  || SELEZIONE ATA 1 -> FE30 - FE37, FE3C, FE3E - FE3F
 42  |  ATA1 = (ATA1A # ATA1B # ATA1C)
 43  || ENABLE WAIT ATA 0
 44  |  WATA0 = ((ATA0A # ATA0B) & WA0')
 45  || ENABLE WAIT ATA 1
 46  |  WATA1 = ((ATA1A # ATA1B) & WA1')
 47  ||
 48  || --------------------------------------------------------
 49  || DMA & FDC
 50  || DMA -> FE60 - FE6F
 51  |  DMAS = (IO1' & A7' & A6  & A5  & A4')
 52  || FDC -> FE58 - FE5F
 53  |  FDCS = (IO1' & A7' & A6  & A5' & A4  & A3)
 54  |  DMA = DMAS
 55  |  FDC = FDCS


 56  ||
 57  || --------------------------------------------------------
 58  || IOY -> FE40 - FE4F
 59  |  IOY = (IO1' & A7' & A6  & A5'  & A4')
 60  || RTC -> FE4C - FE4D
 61  |  RTCA = (IOY & A3 & A2  & A1')
 62  || VDC -> FE4E - FE4F
 63  |  VDCA = (IOY & A3 & A2  & A1)
 64  || CTC -> FE48 - FE4B
 65  |  CTCA = (IOY & A3 & A2')
 66  || SELEZIONE RTC, CTC
 67  |  IOX = (RTCA # CTCA)
 68  |  VDC = VDCA
 69  || WAIT CTC
 70  |  WCTC = (CTCA & WT')
 71  || WAIT VDC
 72  |  WVDC = (VDCA & WV')
 73  ||
 74  || --------------------------------------------------------
 75  || PIA -> FE28 - FE2B
 76  |  PIA = (IO1' & A7' & A6' & A5  & A4' & A3 & A2')
 77  ||
 78  || --------------------------------------------------------
 79  || SEGNALE WAIT 
 80  |  WAIT = (WATA0 # WATA1 # WCTC # WVDC)



I200  No fatal errors found in source code (logic phase).
I201  No warnings.


I202  7/24/12  11:17 am  (Tuesday)
I203  Memory usage 100K
I204  Elapsed time 1 second

OrCAD DEVICE FITTER  v2.01   12/09/94  (Source file .\PLD\#0151.PLA)

I289  Simple GAL architecture selected.



RESOLVED EXPRESSIONS (Reduction 0)

Signal name      Row   Terms

ATA0              56   A0' A1' A2  A3  A4' A5  A6' A7' IO1' 
                  57   A1  A2  A3  A4' A5  A6' A7' IO1' 
                  58   A3' A4' A5  A6' A7' IO1' 

ATA1              48   A0' A1' A2  A3  A4  A5  A6' A7' IO1' 
                  49   A1  A2  A3  A4  A5  A6' A7' IO1' 
                  50   A3' A4  A5  A6' A7' IO1' 

DMA               40   A4' A5  A6  A7' IO1' 

FDC               32   A3  A4  A5' A6  A7' IO1' 

IOX               16   A1' A2  A3  A4' A5' A6  A7' IO1' 
                  17   A2' A3  A4' A5' A6  A7' IO1' 

VDC               24   A1  A2  A3  A4' A5' A6  A7' IO1' 

PIA                8   A2' A3  A4' A5  A6' A7' IO1' 

WAIT               0   A1  A2  A3  A4' A5' A6  A7' IO1' WV' 
                   1   A1  A2  A3  A4' A5  A6' A7' IO1' WA0' 
                   2   A1  A2  A3  A4  A5  A6' A7' IO1' WA1' 
                   3   A2' A3  A4' A5' A6  A7' IO1' WT' 
                   4   A3' A4' A5  A6' A7' IO1' WA0' 
                   5   A3' A4  A5  A6' A7' IO1' WA1' 




SIGNAL ASSIGNMENT
                                      Rows
 Pin    Signal name   Column     --------------    Activity
                                 Beg Avail Used

  1.     A0              2        -    -    -        High    (Clock)
  2.     A1              0        -    -    -        High     
  3.     A2              4        -    -    -        High     
  4.     A3              8        -    -    -        High     
  5.     A4             12        -    -    -        High     
  6.     A5             16        -    -    -        High     
  7.     A6             20        -    -    -        High     
  8.     A7             24        -    -    -        High     
  9.     IO1            28        -    -    -        High     
 10.     -              32        -    -    -                 
 11.     WA0            36        -    -    -        High     
 13.     WA1            38        -    -    -        High    (Enable)
 14.     WV             34        -    -    -        High     
 15.     ATA0           31       56    8    3        Low      
 16.     ATA1           27       48    8    3        Low      
 17.     DMA            23       40    8    1        Low      
 18.     FDC             -       32    8    1        Low      
 19.     VDC             -       24    8    1        Low      
 20.     IOX            19       16    8    2        Low      
 21.     PIA            15        8    8    1        Low      
 22.     WAIT           11        0    8    6        Low      
 23.     WT              6        -    -    -        High     
                                    ---- ----
                                      64   18  (28%)


I200  No fatal errors found in source code (device phase).
I201  No warnings.



OrCAD DEVICE
Type:       GAL20V8
*
QP24* QF2706* QV1024*
F0*
L0000 01 11 01 11 01 11 10 11 10 11 01 11 10 11 10 11 11 10 11 11 *
L0040 01 11 01 11 01 11 10 11 01 11 10 11 10 11 10 11 11 11 10 11 *
L0080 01 11 01 11 01 11 01 11 01 11 10 11 10 11 10 11 11 11 11 10 *
L0120 11 11 10 10 01 11 10 11 10 11 01 11 10 11 10 11 11 11 11 11 *
L0160 11 11 11 11 10 11 10 11 01 11 10 11 10 11 10 11 11 11 10 11 *
L0200 11 11 11 11 10 11 01 11 01 11 10 11 10 11 10 11 11 11 11 10 *
L0320 11 11 10 11 01 11 10 11 01 11 10 11 10 11 10 11 11 11 11 11 *
L0640 10 11 01 11 01 11 10 11 10 11 01 11 10 11 10 11 11 11 11 11 *
L0680 11 11 10 11 01 11 10 11 10 11 01 11 10 11 10 11 11 11 11 11 *
L0960 01 11 01 11 01 11 10 11 10 11 01 11 10 11 10 11 11 11 11 11 *
L1280 11 11 11 11 01 11 01 11 10 11 01 11 10 11 10 11 11 11 11 11 *
L1600 11 11 11 11 11 11 10 11 01 11 01 11 10 11 10 11 11 11 11 11 *
L1920 10 10 01 11 01 11 01 11 01 11 10 11 10 11 10 11 11 11 11 11 *
L1960 01 11 01 11 01 11 01 11 01 11 10 11 10 11 10 11 11 11 11 11 *
L2000 11 11 11 11 10 11 01 11 01 11 10 11 10 11 10 11 11 11 11 11 *
L2240 10 10 01 11 01 11 10 11 01 11 10 11 10 11 10 11 11 11 11 11 *
L2280 01 11 01 11 01 11 10 11 01 11 10 11 10 11 10 11 11 11 11 11 *
L2320 11 11 11 11 10 11 10 11 01 11 10 11 10 11 10 11 11 11 11 11 *
L2560 00 00 00 00 00 11 00 00 00 11 00 01 00 11 01 01 00 11 00 01 *
L2600 00 10 00 00 00 10 00 00 00 10 00 00 00 10 00 00 00 00 00 00 *
L2640 11 11 11 11 11 11 11 11 11 11 11 11 11 11 11 11 11 11 11 11 *
L2680 11 11 11 11 11 11 11 11 11 11 11 11 10 *
C5A6A*

I202  7/24/12  11:17 am  (Tuesday)
I203  Memory usage 8K
I204  Elapsed time 1 second